Tipos de Ruido
Tipos de Ruido
Tipos de Ruido
Campos
eléctricos
Fluctuaciones
de la Campos
alimentación magnéticos
Tipos
de ruido
Transitorios Descargas
electrostáticas
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EMC y Seguridad funcional
Cada una de estas tres metodologías, Figura 1-11, comporta un nivel de preci-
sión y un tiempo de ejecución distintos. Las reglas de diseño son de simple aplica-
ción y no requieren mucho tiempo para llegar a un resultado, pero la precisión que
se obtiene no es muy elevada. Al ser reglas generales, no particularizan en un
diseño concreto, no obstante, sirven como cultura de base para evaluar si una
solución es mejor que otra. Conviene no confundir que las reglas de diseño no
pueden suplir la falta de experiencia y los conocimientos básicos de diseño de
lógica de alta velocidad, RF o líneas de transmisión.
45
Condiciones reales de ensayos de EMC
56
Fundamentos electromagnéticos
3.5. La inductancia
La inductancia es uno de los conceptos más desconocidos en el diseño y ela-
boración de los productos electrónicos. La inductancia “descontrolada”, es decir, lo
que habitualmente conocemos como inductancia parásita, producida por las co-
nexiones, terminales de los componentes, vías o planos de alimentación y masa,
afecta de una manera decisiva al comportamiento de los circuitos electrónicos y
además es la máxima responsable de muchos de los problemas relacionados con
las EMC y la integridad de la señal. La inductancia en los planos masa hace que
éstos no sean equipotenciales, es decir, que el nivel de voltaje no sea el mismo en
todos sus puntos, cuando estos planos están recorridos por corrientes de alta fre-
cuencia, producidas por las propias demandas de corrientes de los circuitos inte-
grados. Si los planos no son equipotenciales significa que existen diferencias de
tensión entre un punto y otro del mismo plano, por lo que podemos afirmar que el
plano de masa se convierte en un generador de radio frecuencia.
81
La inductancia
Tabla 3-1. La impedancia del circuito impreso puede realzar el ruido de la masa.
Por todo lo anterior, es interesante conocer la inductancia de un circuito cerra-
do, compuesto de una pista de señal más su retorno en el plano de masa, para
poder anticipar problemas de emisiones radiadas, crosstalk de impedancia común
o ruido delta I en los circuitos que vamos a diseñar. Una fórmula que nos va a
aproximar cual es la inductancia de la masa se muestra en la Ecuación 3-63:
μ0 ⎛ πh ⎞
LGND = l ln⎜⎜ + 1⎟⎟ en H.
2π ⎝ WGND ⎠
Ecuación 3-63. Inductancia del plano de masa.
Donde: LGND Inductancia del plano de masa en H.
µ0 Permeabilidad en el vacío. (4π x 10-7 H/m).
ℓ Longitud de la masa.
W Anchura de la masa.
h Altura de la pista hasta la masa.
90
Diseño orientado a EMC
conducen esta corriente hasta la carga. El sentido de estas corrientes está indica-
do en las pistas mediante la flecha gruesa. Como consecuencia de la corriente
que circula por cada una de las pistas, se producen líneas de campo magnético
con un sentido de giro determinado por la polaridad de estas corrientes.
100
Fundamentos electromagnéticos
módulo, ésta alcanza una parte metálica cualquiera y produce una fuerte corriente
a través de pistas, planos de alimentación, radiadores, blindajes o cualquier objeto
metálico hasta alcanzar a través de las capacidades parásitas, el plano de test.
En la Figura 3-29 podemos ver dos ejemplos de descargas de ESD aplicadas
a módulos electrónicos. En la parte superior, la descarga alcanza un pin de entra-
da de un conector. La corriente circulará a través de la resistencia R, después una
parte de la corriente y dependiendo de la polaridad de la descarga lo hará por D1
o D2. Una descarga positiva va a incrementar el nivel de tensión del punto +5V,
por lo que un mal desacoplo del microcontrolador se traducirá en una destrucción
del mismo. Otra parte importante de la corriente circulará por C y finalmente todas
estas corrientes alcanzarán las capacidades parásitas.
La inmunidad frente a transitorios de ESD va a depender en gran medida del
valor que tomen estas capacidades parásitas, por lo que es muy importante man-
tener la distancia entre el plano de referencia y el módulo electrónico recomenda-
da en las especificaciones del ensayo, así como un control estricto del grado de
humedad en el ambiente.
El tipo de material indicado como aislante también debe ser respetado, ya que
el mismo actúa como dieléctrico, aumentando estas capacidades.
Capacidad parásita
Plano metálico
CI
Blindaje
Capacidad parásita
Plano metálico
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Ruido en los circuitos
Salida del
uControlador Medida del
activa a 0 ground
bounce
Figura 4-18. Así quedarán las dos mirillas para analizar el bounce.
Maximizar la capacidad on-chip. Esto creará una reserva de energía que no
estará afectada por la inductancia.
Maximizar la capacidad de desacoplo. Usar condensadores land-side o
bien die-side, siempre que sea posible. Colocar los condensadores lo más
cerca posible de los pines de alimentación.
Aumentar los tiempos de transición en los flancos, pero cuidado que puede
ser un arma de doble filo. Hacer los flancos más lentos los hace más sus-
ceptibles al ruido, cuanto más lentos más probabilidades de que se acople
ruido en el flanco y producir jitter.
Reducir la inductancia tanto como sea posible, usando siempre pistas
gruesas de alimentación y planos.
Minimizar la inductancia de los condensadores de desacoplo y de las vías.
Evitar retornos no ideales.
Configurar los pines no usados del microcontrolador como salidas y activar-
las a nivel bajo, para reducir el ground bounce. Esta configuración refuerza
la conexión a masa del microcontrolador.
Configurar los pines no usados del microcontrolador como salidas y activar-
las a nivel alto, para reducir el VCC bounce. Esta configuración refuerza la
conexión a la alimentación del microcontrolador.
Eliminar los zócalos de los integrados, ya que tienen una considerable in-
ductancia.
Hacer que las salidas del microcontrolador que llevan señales de frecuen-
cia media o alta sean las que tienen cerca una conexión de masa.
Crear diseños síncronos que no se vean afectados por los ruidos de masa.
Usar circuitos impresos multicapa.
Evitar que varias salidas conmuten al mismo tiempo. Decalar las salidas en
el tiempo.
153
Contaminación de los planos
Vía a
Vía a
GND
+5V
-ISUPP
ISUPP
Vía a
Vía a
GND
+5V
Figura 8-27. Disposición para reducir el ruido en la entrada de alimentación del CI.
Vía a
+5V
Vía a
GND
314
Corrientes parásitas a través de los radiadores
las corrientes parásitas tengan valores considerables al estar creadas por tensio-
nes con una dV/dt elevada. La Figura 10-10 es un ejemplo de corrientes parásitas
de alta frecuencia, producidas por la capacidad parásita de semiconductores del
clásico formato TO-220.
380V
dV/dt
80 ns
Termo-silicona 0,0884 * ε r * A
C= =
C≈55 d
p F 0,0884 * 4,5 *1,4
= = 55 pF
260 0,01
m A
C = Capacidad en pF
A = Area en cm2
εr = Constante dieléctrica
d = Separación en cm
∆V = Variación de la tensión
t = Tiempo
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Diseño analógico y de potencia
geometría correcta de pistas de circuito impreso, de tal modo que garantice que
todos los caminos de retorno de las corrientes de cada condensador tenga la mis-
ma longitud.
Corrientes
10.6.2. Snubbers
En circuitos de potencia los elementos de conmutación como FETs o IGBTs,
que controlan cargas inductivas, deben estar correctamente protegidos en los
momentos de desconexión de las mismas para evitar las sobre oscilaciones o
ringings cuya amplitud puede destruir tales elementos.
Estas oscilaciones, con una frecuencia definida, son debidas a la inductancia
parásita del circuito a la que hay que añadir la inductancia dispersa en el caso de
transformadores y la capacidad parásita. Todo este conjunto de elementos parási-
tos constituyen un circuito resonante capaz de generar tensiones muy elevadas
que pueden poner en peligro los dispositivos semiconductores de conmutación. La
forma más fácil de reducir estos niveles de tensión consiste en utilizar una red RC,
serie conocida como snubber. Los valores de estos componentes deben ser los
apropiados para cada caso. En general, los pasos a seguir para determinar los
valores son los siguientes:
Medir la frecuencia de resonancia de la sobre oscilación (f en la Figura
10-15 izquierda).
Añadir un condensador entre drain y source del MOSFET, empezando por
un valor pequeño y aumentando progresivamente hasta que la frecuencia
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Investigación de causas
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