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    Cours I2C

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    Le document décrit le bus I2C, une norme de communication série entre circuits intégrés. Le bus I2C permet des connexions sur courte distance entre un maître et des esclaves via deux fils de données et d'horloge. Le protocole de communication I2C est détaillé.

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    Bus I2C

    Ce document est une introduction à la norme orsI2C, pour plus d’informations consultez :
    The I2C-bus and how to use it (pdf) de Philips Semiconductors
    http://www.i2c-bus.org/fileadmin/ftp/i2c_bus_specification_1995.pdf
    2
    Le bus I C (IIC : Inter-IC-Communication ) permet la connexions de circuit intégrés à proximité
    (1m). Les caractéristiques électriques et le protocole de communication ont été déposés par Philips,
    l’I2C est devenu un standard industriel utilisé par de très nombreux constructeurs.

    C’est un bus de communication séries synchrones, bidirectionnel avec un protocole de


    reconnaissance. La fréquence de transfert est comprise entre 100KHz et 400KHz.
    Le bus est piloté par un maitre (MASTER) qui génère l’horloge de communication. (il est possible de
    travailler en mode multi-maitre). Tous les autres circuits sont esclaves (SALVES), ils reçoivent tous la
    même horloge issue du maitre.

    Le bus est constitué de deux fils (plus une référence de tension) :


    SCL : serial clock qui est l’horloge de cadencement des communications (unidirectionnel)
    SDA : serial data permet les échanges bidirectionnels entre le maitre et un esclave.

    Exemple de connexions I2C :

    Sur le bus I2C le niveau logique dominant est le 0, le niveau récessif est le 1. En absence de
    commande le niveau logique (repos) est donc 1. Les interfaces sont constitués de transistors MOS
    drains ouverts, ce qui élimine tout risque de court-circuit électrique (mais pas de court-circuit logique).
    Le bus doit être équipé de deux résistances de pull-up (4K à 10K)

    Comme entrée et sortie se font sur un même fil, un circuit peut vérifier l’état récessif de la ligne. Il
    place un 1 logique (transistor bloqué) et vérifie que la ligne est bien à 1, dans le cas contraire, c’est
    qu’un autre circuit est en train de placer un 0.
    L’émetteur peut donc vérifier l’émission effective de chaque bit.

    cours I2C.docx 1/4


    Bus I2C

    Protocole I2C :

    Les échanges commencent toujours par une condition START sur SCL/SDA et finissent par une
    condition STOP

    Les bits sont transférés sur le front descendant de SCL

    Les données sont échangées par octets, chaque octet est suivi d’un bit d’acquittement à 0 généré par
    l’esclave et lu par le maitre.
    ts

    Le bus I2C pouvant accueillir plusieurs esclaves ceux-ci sont identifiés par une adresse sur 7 bits, le
    ième
    8 bits de l’octet indique s’il s’agit d’une opération d’écriture dans l’esclave (0) ou de lecture (1).

    Par exemple pour un circuit dont l’adresse est 0b1010000. L’adresse I2C en écriture sera
    0b10100000 (0xA0) et 0b10100001 (0xA1) en lecture.

    Exemple d’échanges

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    Bus I2C

    Le maitre transmet l’adresse d’écriture d’un esclave suivi de deux octets de données.

    Le maitre demande une lecture, l’esclave transmet deux octets, c’est maintenant le maitre aui place
    les acquittements.

    Dans un même échange on peut trouver des écritures puis des lectures d’un esclave :
    Par exemple, la lecture d’un mémoire nécessite l’écriture de l’adresse interne à lire.

    Grace au principe du pull-up, le bus I2C accepte des circuits alimenté avec des tensions différentes
    (sous certaines conditions, voir datasheets)

    cours I2C.docx 3/4


    Bus I2C

    Exemple de périphérique I2C : DAC LTC2631


    CA1-CA0
    définissent
    l’adresse I2C
    du DAC

    Nombre correspondant à la tension à


    produire sur 12bits
    (Les 4 derniers bits ne sont pas utilisés)

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