Este proyecto busca diseñar e implementar un circuito de enganche de fase PLL con frecuencímetro digital utilizando circuitos básicos como OPAMPs y osciladores. El sistema debe medir la frecuencia de salida de un VCO diseñado e implementado y mostrar el valor en un LCD, con un rango mayor a 100KHz.
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Este proyecto busca diseñar e implementar un circuito de enganche de fase PLL con frecuencímetro digital utilizando circuitos básicos como OPAMPs y osciladores. El sistema debe medir la frecuencia de salida de un VCO diseñado e implementado y mostrar el valor en un LCD, con un rango mayor a 100KHz.
Descripción original:
proyecto de electrónica aplicada universidad distrital, no solución
Este proyecto busca diseñar e implementar un circuito de enganche de fase PLL con frecuencímetro digital utilizando circuitos básicos como OPAMPs y osciladores. El sistema debe medir la frecuencia de salida de un VCO diseñado e implementado y mostrar el valor en un LCD, con un rango mayor a 100KHz.
Este proyecto busca diseñar e implementar un circuito de enganche de fase PLL con frecuencímetro digital utilizando circuitos básicos como OPAMPs y osciladores. El sistema debe medir la frecuencia de salida de un VCO diseñado e implementado y mostrar el valor en un LCD, con un rango mayor a 100KHz.
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ELECTRÓNICA APLICADA, Pr.
Aldemar Fonseca Velásquez, 2020-3
2. Proyecto: Phase Locked Loop (PLL) CON FRECUENCIMETRO
DIGITAL OBJETIVO:
Diseñar, implementar y verificar un circuito de enganche de fase PLL con frecuencímetro
digital basado en circuitos básicos realimentados y osciladores.
MATERIAL NECESARIO:
OPAMPs, Transistores, pulsadores, sistemas digitales, kit de herramientas, equipos y
componentes electrónicos.
DESARROLLO:
De acuerdo con el diagrama de bloques propuesto, diseñar, implementar y verificar un
circuito de enganche de fase con frecuencímetro digital, cuyo rango de frecuencias sea superior a 100KHz. El sistema debe estar basado en diseño e implementación de un VCO discreto y la frecuencia a la salida del VCO debe ser medida para observarse el valor en un LCD.
En este diagrama el elemento central es el oscilador controlado por voltaje VCO. Un VCO es un oscilador cuya frecuencia depende de un nivel de voltaje DC en su entrada. Existen varias técnicas para implementarlo, en este proyecto se puede usar cualquiera, pero debe ser diseñado e implementado (no un circuito integrado). Un PLL típico, lo compone un detector de fase que compara la fase de la señal de entrada con la salida del VCO, un filtro pasa bajas que obtiene un promedio de la señal de salida del detector de fase y lo inyecta a la entrada del VCO, obteniéndose una corrección de la frecuencia hasta que el VCO se enganche con la frecuencia y fase de la entrada. Por supuesto, la señal de entrada del PLL debe estar dentro del rango de trabajo del VCO. Por último, el proyecto requiere un medidor de frecuencia a la salida del VCO que visualice el valor de la frecuencia en todo momento. Como la señal tal vez no sea una onda cuadrada exactamente, tal vez sea necesario pasarla por un comparador.
Uno de varios circuitos de PLL propuesto, podría ser:
VCC
R5 R7 R4 R3
Q1 Q2 XSC2
G C1 T R6 R8 A B C D R1 R2
R15 VCC R9 C3 VCC VCC R13 R11 3
R12 12
U3A
VCC U2A R14 3
7 V1 1
6 12
U3B
Pero no es necesario que se limite a este diagrama (es sólo una propuesta)
NOTAS IMPORTANTES:
Una vez implementado el sistema, realice mediciones en cada etapa para consignar los niveles de voltajes DC y AC. De igual forma observe las señales en el osciloscopio y verifique lo obtenido con respecto al diseño, midiendo en cada etapa la forma de onda, la frecuencia y la amplitud.
En el informe que se consigne en el cuaderno de laboratorio registre brevemente
una introducción, el proceso de desarrollo realizado, el plano eléctrico del sistema, las mediciones realizadas en el laboratorio, las conclusiones y la bibliografía.
Este proyecto debe ser entregado completamente funcional en sesión de laboratorio con las mediciones respectivas a más tardar en la fecha señalada en la agenda del curso. Se podrá entregar en fecha extraordinaria una semana más tarde con una penalización de 1,0.
