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    Tabla Comparativa: Flip Flop VS Latch

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    Noé Beltrán
    Tabla donde se menciona las aplicaciones del flip flop y aplicaciones del Latch así como las características del flip flop y características del latch

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    Tabla comparativa: Flip Flop VS Latch

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    Presentado por Noé Jafet Hernández

    CUADRO COMPARATIVO Hernández


    FLIP FLOP & LATCH Mecatrónica 6° “A” 15TE0302
    MICROCONTROLADORES

    FLIP FLOP LATCH

    D
    E Son dispositivos de dos estados (biestables), que sirven El latch S-R es un tipo de multivibrador biestable. Las
    F como memoria básica para las operaciones de lógica letras S-R significan Set-Reset con entrada activa a
    I nivel alto. Se compone de dos compuertas NOR
    secuencial. Los Flip-flops son ampliamente usados para
    N acopladas.
    I el almacenamiento y transferencia de datos digitales y Son circuitos biestables porque poseen estados de
    C se usan normalmente en unidades llamadas “registros”, SET (activado) y RESET (desactivado) en los cuales se
    I para el almacenamiento de datos numéricos binarios. permite mantener informacion de forma indefinida.
    Ó
    N

    T
    Asíncronos: Sólo tienen entradas de control. El más Entrada activa en alto que compone de dos
    I empleado es el flip flop RS. compuertas NOR

    P Entrada activa en bajo, formado por dos


    compuertas NAND. La salida está conectada a la
    Síncronos: Además de las entradas de control necesita
    O entrada de las compuertas, lo cual genera la
    un entrada sincronismo o de reloj. realimentación o feedback.
    S
    CA a) Funcionan de acuerdo a los niveles de señales de
    TIEMPO DE RESPUESTA: Cada pulso del reloj. entrada.
    RA b) Se diferencian de los flips—flops en el método
     Asumen solamente uno de dos posibles estados empleado para cambiar de estado.
    CT de salida. c) Realimentación regenerativa común a ambos.
    d) Son circuitos que almacenan datos.
     Tienen un par de salidas que son complemento
    ER e) Dispositivo de almacenamiento temporal de dos
    una de la otra. estados (biestable).
    IS  Tienen una o más entradas que pueden causar f) Los latches básicos son construidos con circuitos
    que el estado del Flip-Flop cambie. NAND y NOR.
    TI g) El concepto clave es la realimentación.
    h) Los Latches funcionan gracias a que las puertas
    CAS lógicas tienen retardos en la propagación de las
    señales.
    Flip-Flop R-S (Set-Reset) Un latch es un tipo de multivibrador biestable.
    Utiliza dos compuertas NOR. S y R son las entradas,
    mientras que Q y Q’ son las salidas (Q es generalmente Un latch S-R (Set-Reset) con entrada activa a nivel
    la salida que se busca manipular.) alto se compone de dos puertas NOR acopladas tal
    La conexión cruzada de la salida de cada compuerta a la como se muestra en la figura 1; un latch S-R con
    C entrada de la otra construye entrada activa a nivel bajo está formado por dos
    O el lazo de reglamentación puertas NAND conectadas.
    N imprescindible en todo
    F dispositivo de memoria.
    I
    G
    U Flip-Flop T
    R El Flip-flop T cambia de estado en cada pulso de T. El
    A pulso es un ciclo completo de cero a 1.
    C Con el flip flop T Esto origina la realimentación (feedback) regenerativa
    I podemos característica de todos los multivibradores.
    O complementar una
    N entrada de reloj al Latch ~R - ~S
    E flip flop rs. Este latch tiene las mismas caracteristicas que el latch
    S S-R considerando que sus entradas son activas a nivel
    Flip-Flop J-K (Jump-Keep) bajo. Se compone de dos compuertas NAND
    El flip-flop J-K es una mezcla entre el flip-flop S-R y el acopladas
    flip-flop T.
    A diferencia del flip flop
    RS, en el caso de activarse
    ambas entradas a la vez,
    la salida adquiere el
    estado contrario al que
    tenía.

    Flip-Flop D (Delay)
    El flip-flop D es uno de los FF más sencillos. Su función
    es dejar pasar lo que entra por D, a la salida Q, después
    de un pulso del reloj.
    Flip Flop Maestro-Esclavo: Circuito Antirrebote:
    Cada pulso en el clock hará que la señal entre al sistema Cualquier interruptor al ser posicionado en un estado,
    genera rebotes. Estos rebotes, generalmente no son
    (como salida del FF-D-AN) y salga la misma a la salida
    visibles, dado a que su frecuencia es muy alta. Sin
    final respetando la tabla de verdad del FF esclavo. Así, si embargo si se conectara un dispositivo a un
    el esclavo es un FF-X-AN, todo el conjunto se comporta interruptor, el rebote que genera pequeños pulsos
    indeseables que un circuito puede detectar.
    como un FF-X-ME
    Para construir este circuito, se requiere un latch S-R y
    un interruptor de 3 pines 2 posiciones. Cuando el
    Alarma con Flip Flops: interruptor coloca un 1 logico en la entrada R, se
    genera un Reset, debido a que la entrada S estaria en
    una simple alarma basada en configuración flip/flop bajo
    0 logico por medio de la resistencia a tierra. En el
    un integrado 4093 de fácil adquisición, Tenemos como momento de haber un rebote, la entrada R y la
    sensor una fotocelda la cual al recibir la luz es acoplada entrada S, quedan en 0 logico generando a la salida
    a una de las compuertas AND la cual tiene como un estado de no cambio. Una vez finalizado el rebote,
    vuelve a estar en estado de Reset hasta quedar la
    referencia las resistencias de 10K y 1M, a la salida de
    entrada en estado estable. Entonces para el rebote
    AP estas tenemos un led indicador de estado mientras que generado en el interruptor de entrada, a las salidas Q
    el otro extremo es conectado a otra NAND la cual y ~Q se obtiene una señal sin rebotes.
    LI
    mediante el trimmer preset de 10K ajusta la respuesta
    CA Latch S-R con habilitación
    de disparo de la alarma la cual es emitida por el piezo El latch S-R, actua en el mismo instante en que se
    CI controlado por el BC547B. modifique las entradas. Si se quisiera pasar de Set a
    Reset, seria necesario pasar por el estado No cambio
    ON
    para no alterar las salidas. Sin embargo en este latch
    Almacenador de Bits: se puede cometer el erro de pasar por el estado
    ES
    Un registro es un grupo de celdas de almacenamiento invalido, lo que podria generar un error en la salida
    binario adecuadas para mantener información binaria. del circuito.
    Y La solucion al problema planteado es agregarle una
    Un grupo de flip-flop constituye un registro, ya que cada linea de habilitacion al latch, de tal manera que solo
    flip-flop es una celda binaria capaz de almacenar un bit trabaje cuando esta linea se encuentre activa.
    FU
    de información. Este circuito trabaja exactamente igual al latch S-R
    NC con una funcion adicional. Si la entrada EN es 0, la
    Un registro de n-bit tiene un grupo de n
    salida siempre sera No cambio. Este comportamiento
    IO flip-flop y es capaz de almacenar cualquier información describe el almacenamiento de un bit de informacion.
    binaria que contenga n bits. Además de los flip-flop, un
    NA
    registro puede tener compuertas combinacionales
    MI querealicen ciertas tareas de procesamiento de datos.

    EN En su definición más amplia, un registro consta de un


    grupo de flip-flop y compuertas que efectúan una
    TO
    transición. Los flip-flop mantienen la información binaria
    y las compuertas controlan cuando y como se transfiere
    información nueva al registro.

    Contador: Latch D con habilitación


    Una señal repetitiva en la entrada de reloj hace que el El latch S-R con habilitacion, sigue teniendo el
    biestable cambie de estado por cada transición alto-bajo inconveniente de presentar el estado no valido.
    El latch D, es una implementacion que permite
    si su entrada T está a nivel 1. La salida de un biestable eliminar este estado mejorando el comportamiento del
    puede conectarse a la entrada de reloj de la siguiente y latch.
    así sucesivamente. La salida final del conjunto
    considerado como una cadena de salidas de todos los
    biestables es el conteo en código binario del número de
    ciclos en la primera entrada de reloj hasta un máximo de
    𝟐𝒏−𝟏 , donde 𝒏 es el número de biestables usados

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